PIC24F08KL401-I/SS【PDF 142/260 页】IC MCU 16BIT 8KB FLASH 20-SSOP

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CHAPTER 7 16-BIT TIMER/EVENT COUNTERS 0 AND 1

User’s Manual U15905EJ2V1UD

224

(3) Capture operation

The TMn register has two capture/compare registers. These are the CCn0 register and the CCn1 register. A

capture operation or a compare operation is performed according to the settings of both the CMSn1 and

CMSn0 bits of the TMCn1 register. If the CMSn1 and CMSn0 bits of the TMCn1 register are set to 0, the

A capture operation that captures and holds the TMn count value asynchronously to the count clock is

performed in synchronization with an external trigger.

The valid edge that is detected from an external

interrupt request input pin (INTPn0 or INTPn1) is used as an external trigger (capture trigger). The TMn count

value during counting is captured and held in the capture register, in synchronization with that capture trigger

signal. The capture register value is held until the next capture trigger is generated.

Also, an interrupt request (INTCCn0 or INTCCn1) is generated by INTPn0 or INTPn1 signal input.

The valid edge of the capture trigger is set by valid edge select register n (SESn).

If both the rising and falling edges are set as capture triggers, the input pulse width from an external source

can be measured. Also, if only one of the edges is set as the capture trigger, the input pulse cycle can be

measured.

Remark

n = 0, 1

Figure 7-4. Capture Operation Example (TM1)

TM1

TMCE1

INTP11

CC11

(Capture register)

(Capture trigger)

Remarks 1. When the TMCE1 bit is 0, no capture operation is performed even if INTP11 is input.

2. Valid edge of INTP11: Rising edge

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